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申威1621
• 基于第三代“申威64”核心（增強版）研制的16核心通用處理器，采用28nm代工工藝，工作頻率設(shè)計目標(biāo)為2GHz；
• 16個核心以CC_NUMA方式共享三級共享Cache，并且三級Cache容量增大到32MB；
• 計算性能：主頻2GHz時的雙精度浮點性能可高達(dá)512GFlops；
• 訪存性能：集成8路64位DDR3存儲控制器，傳輸率達(dá)1066~2133MBps，支持ECC校驗；最大可支持內(nèi)存容量高達(dá)256GB；
• I/O性能：集成2路PCI-E3.0×8接口，雙向聚合有效帶寬提高到32Gbps；
• 申威1621處理器可根據(jù)應(yīng)用需求對核心數(shù)量、存儲控制器和PCI-E接口數(shù)量進行裁剪，提供不同規(guī)模的配置，以降低系統(tǒng)開發(fā)成本和系統(tǒng)功耗；
• 申威1621處理器的主頻、計算性能、訪存性能、I/O性能較之前產(chǎn)品都有大幅度提升，可滿足中高端服務(wù)器以及高性能計算的應(yīng)用需求；
• 該系列處理器同時有4核心版本——申威421，采用LGA封裝；該處理器集成了4顆核心，以及2路DDR3存儲控制器和2路PCI-E3.0標(biāo)準(zhǔn)I/O接口，可滿足低端服務(wù)器和高端桌面應(yīng)用需求。 產(chǎn)品手冊
       申威1621處理器是基于第三代“申威64”核心（增強版）的國產(chǎn)高性能多核處理器，主要面向高性能計算和中高端服務(wù)器應(yīng)用。目前，該處理器已經(jīng)實現(xiàn)量產(chǎn)。
       申威1621采用對稱多核結(jié)構(gòu)和SoC技術(shù)，單芯片集成了16個64位RISC結(jié)構(gòu)的申威處理器核心，目標(biāo)設(shè)計主頻為2GHz。芯片還集成八路DDR3存儲控制器和雙路PCI-E3.0標(biāo)準(zhǔn)I/O接口。


 
參數(shù) 性能指標(biāo)
核心數(shù)量   16
核心頻率   設(shè)計頻率2.0GHz。
峰值運算速度   浮點： 每秒5120億次雙精度浮點結(jié)果@2.0GHz；
  整數(shù)： 每秒2880億次整數(shù)結(jié)果@2.0GHz。
工藝特征   28nm
電壓參數(shù)   內(nèi)核電源： 0.95V±5%；
  I/O電源： 1.5V±10%， 1.8V±10%。
Cache容量   每個核心包含兩級Cache， Cache行長度為128字節(jié)；
  一級Cache： 指令與數(shù)據(jù)分離， 容量為32KB， 采用4路組相聯(lián)結(jié)構(gòu)；
  二級Cache： 指令與數(shù)據(jù)混合， 容量為512KB， 采用8路組相聯(lián)結(jié) 構(gòu)；
  16個核心共享三級Cache， 容量為32MB， Cache行長度為128字節(jié)， 采用32路   組相聯(lián)結(jié)構(gòu)。
存儲空間   支持64位虛地址空間， 實際實現(xiàn)43位虛地址；
  支持40位物理地址。
存儲器接口   八路64位DDR3存儲器接口， 支持糾單錯、 檢雙錯的ECC校驗， 最大傳輸率為
  2133MBps；
  支持的總存儲器容量最大可達(dá)256GB；
  支持連接DDR3 SDRAM芯片、 UDIMM或RDIMM存儲器條。
I/O接口   兩路PCI-E 3.0 ×8接口， 單鏈路有效帶寬8Gbps；
  維護接口支持兼容Jtag標(biāo)準(zhǔn)的芯片調(diào)試與維護。
封裝特性   采用FC-BGA封裝， 封裝引腳數(shù)為2597。
功耗   熱設(shè)計功耗： 90W（16核心） ；
  典型運行功耗： 待實際測量。